Ryzen Threadripper 2990X: Bei Händler für 1585 Euro gelistet

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Nachdem der Threadripper 2990X bereits vor einem Monat bei einem Händler aufgetaucht ist, wurde er nun wieder gelistet - in Kanada. Dort wurden umgerechnet 1.585 Euro ausgerufen, bis das Angebot wieder vom Netz genommen wurde.

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AW: Ryzen Threadripper 2990X: Bei Händler für 1585 Euro gelistet

Was mich seit mehr als einem Jahr wirklich extrem beeindruckt: Wie konnte Intel zu doof sein, auf die triviale Idee zu kommen, selbst die Dies zusammenzuschalten, so wie AMD es jetzt macht? Das Divide and Conquer-Prinzip (divide et impera) ist das erste, was man im Informatikstudium lernt...

Vielleicht wollte das Schicksal es einfach nicht

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Arkintosz schrieb:

Was mich seit mehr als einem Jahr wirklich extrem beeindruckt: Wie konnte Intel zu doof sein, auf die triviale Idee zu kommen, selbst auch die Dies zusammenzuschalten?

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Das können die auch und haben es auch zur Core2 Zeit gemacht (der Q6600 war ein zusammengeklebter Prozessor aus zwei E6600-Dualcore Dies). Nur muss man heutzutage um das zu tun die CPU-Architektur entsprechend auslegen von vorneherein. Beim Core2 wars ne Notlösung: Kommunikation über den lahmen FSB damals. Heute brauchts dafür Ringbus, Mesh, InfinityFabric, was auch immer um nicht vergleichsweise sehr langsam zu sein. Und INtel hat das in seiner Corei-Architektur so nie vorgesehen da sie sich weit im Vorsprung sahen (was auch so war), es war nicht nötig Die-Fläche für sowas zu opfern und man hat den Gewinn maximiert.

Blöderweise hat Intel seine Architektur nunmal seitdem nicht wesentlich verändert (ein Skylake/Kabylake ist im Kern noch immer ein Nehalem von vor 10 jahren und kann Multi-Chip so einfach nicht) und sich dahingehend ausgeruht. Jetzt haben sie den Salat und können nur über Holzhammer kontern (mehr Takt, mehr TDP, mehr Lötzinn, mehr Kerne, schneller um jeden Preis) - das letzte Mal haben sie das beim Pentium4 gemacht als sie keine andere Wahl gegen den überlegenen Athlon(XP) hatten, wie das ausging wissen wir alle.

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Von der8auer gibts übrigens n neues Video zum 32er Epic, mit genauerer RAM-Analyse:



Hier mal der Screen vom RAM-Test:



So lange es beim Threadripper 2990X eine RAM-Anbindung mit niedriger Latenz wird (vermutlich Left 2+2, ABEF?), sollten die Einbußen in der Performance durch den Wegfall von 4 Speicherkanälen in der Tat überschaubar bleiben. Dann würde ich vermutlich bei 1200€ (also nach ein paar Monaten?), spätestens aber bei 1000€ (nach nem Jahr?) die Vernunft über Board werfen, und mir so ein Teil ins Gehäuse löten.

Ein 1950X kostet aktuell übrigens nur noch 770€ (weil im Artikel glaube 820€ stand).


Edit: Irgendwie macht das Einbetten von Bildern bei mir Probleme...

Edit2: Irgendwie komm ich langsam durcheinander. Wird TR2 pro CCX doppelt so viele Kerne haben, oder werden einfach alle 4 Dies (des TR1) aktiviert? Macht bzgl. der RAM-Anbindung dann ja doch nen deutlichen Unterschied.

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Bei der Cacheangabe von 80MiB ist es vermutlich logischer, wenn L2 + L3 (mal wieder) addiert wurden.

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Blöderweise hat Intel seine Architektur nunmal seitdem nicht wesentlich verändert (ein Skylake/Kabylake ist im Kern noch immer ein Nehalem von vor 10 jahren und kann Multi-Chip so einfach nicht) und sich dahingehend ausgeruht. Jetzt haben sie den Salat und können nur über Holzhammer kontern (mehr Takt, mehr TDP, mehr Lötzinn, mehr Kerne, schneller um jeden Preis) - das letzte Mal haben sie das beim Pentium4 gemacht als sie keine andere Wahl gegen den überlegenen Athlon(XP) hatten, wie das ausging wissen wir alle.

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Geile Zeit !
Ich hab seit ein paar Tagen einen HP Thin Client 5725 mit Athlon T BredB alias GEODE NX drauf , im Desktop knapp um 50 watt bei 2 Ghz im Thin Client 1 Ghz bei 6,5 Watt !!!
Also bei Laptops um 2000-2003 muss Intel mit dem PIV kein Land gesehen haben

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Incredible Alk schrieb:

Das können die auch und haben es auch zur Core2 Zeit gemacht (der Q6600 war ein zusammengeklebter Prozessor aus zwei E6600-Dualcore Dies). .

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Na ja, mein Q 6700 hat 8 Jahre lang gelebt ohne jegliche Änderung mit ordentlich Dampf für alle anliegenden Aufgaben.
Das war mit der HD 6870 schon ein Hammerteil mit sehr starker Gesamtperformance.

Da hat nichts geruckelt bis zum Rücktritt in die Reserve.

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Ich hab nirgends behauptet dass die Core2Quads schlecht waren - ich hatte selbst nen Q6600 der übrigens bis heute bei einem Kollegen läuft.
Es ging nur darum zu sagen dass INtel auch schon mehrere Dies zusammengeklebt hat damals.

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INU.ID schrieb:

Von der8auer gibts übrigens n neues Video zum 32er Epic, mit genauerer RAM-Analyse:

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Achtung: Er hat selbst im Video gesagt, dass die Statistiken im Grunde genommen eig. nichts wirklich viel aussagend sind.
Der Latenz unterschied wird durch ein Software Problem verursacht. Da das Programm immer nur vom DIE 1 aus misst.

Dies bedeutet, dass das was wir da an höherer Latenz sehen, der Defizit sein müsste, wenn der Memory controller auf ein andern DIE liegt?
(Sprich man könnte es mit ein Threadripper mit 4 DIEs aber 2 Memory controllern vergleichen?)

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Frontline25 schrieb:

Der Latenz unterschied wird durch ein Software Problem verursacht. Da das Programm immer nur vom DIE 1 aus misst.

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Genau, und man erstmal davon ausgehen muß, dass das alle Programme so machen, die nicht an TR angepasst wurden und werden (oder wenn Windows dahingehend nicht angepasst wird)

Dies bedeutet, dass das was wir da an höherer Latenz sehen, der Defizit sein müsste, wenn der Memory controller auf ein andern DIE liegt?
(Sprich man könnte es mit ein Threadripper mit 4 DIEs aber 2 Memory controllern vergleichen?)

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So habe ich es verstanden. Deswegen meine Frage wegen den Kernen pro CCX. Bei einer Verdopplung bräuchte TR2 für 32 Kerne - wie TR1 für 16 Kerne - zwei aktivierte Dies mit jeweils 2 Speicherkanälen.

Sind die Kerne pro CCX beim TR2 aber noch nicht verdoppelt (TR2 = ein TR1 mit 4 statt 2 aktivierten Dies), dann würden 2+2 Speicherkanäle bedeuten, das 2 Dies gar nicht direkt mit dem RAM verbunden sind. Deswegen bin ich gerade etwas verwirrt wegen den aktivierten Dies beim TR2 (im Video meinte Roman glaube es wäre wie beim TR1, also 2 aktivierte und 2 Dummy-Dies - dann wäre der maximale Epic-Ausbau eine CPU mit 64 Kernen und 128 Threads).

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INU.ID schrieb:

Sind die Kerne pro CCX beim TR2 aber noch nicht verdoppelt (TR2 = ein TR1 mit 4 statt 2 aktivierten Dies), dann würden 2+2 Speicherkanäle bedeuten, das 2 Dies gar nicht direkt mit dem RAM verbunden sind. Deswegen bin ich gerade etwas verwirrt wegen den aktivierten Dies beim TR2 (im Video meinte Roman glaube es wäre wie beim TR1, also 2 aktivierte und 2 Dummy-Dies - dann wäre der maximale Epic-Ausbau eine CPU mit 64 Kernen und 128 Threads).

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In der Tat haben nur 2 Dies direkten Memoryzugriff. Ohne die 2 zusätzlichen Dies würde die Kernanzahl bei Zen+ nicht hinkommen. Allerdings ist bei vielen Anwendungen der Speicherzugriff egal und der L2 Cache ist sowieso immer lokal. Wer keine Software einsetzt, die damit klarkommt, ist mit dem großen TR2 nunmal schlecht bedient.

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INU.ID schrieb:

dann wäre der maximale Epic-Ausbau eine CPU mit 64 Kernen und 128 Threads).

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Alles Utopie.
So etwas werde ich mir nie leisten können.

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Kommt da eventuell noch ein 10 / 12 Kerner? Oder bleibt es bei den beiden zwei TR Modellen?

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Da werden schon kleinere kommen, aber könnte sein das 12 oder 16 óder 24 diesmal das Minimum wird.

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xtrame90 schrieb:

Kommt da eventuell noch ein 10 / 12 Kerner? Oder bleibt es bei den beiden zwei TR Modellen?

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Anscheinend 16,24 und 32 Kerne.

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Selbst der 16 Kerner wäre zu viel. Der 8 Kerner war damals perfekt :/

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Wenn du nicht so viele Kerne brauchst ist vll Intel besser für dich da vermutlich höherer Takt möglich.
Evtl ist der 16-Kern aber schon relativ günstig zu haben, falls es stört könnte man wahrscheinlich welche selbst abschalten.

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Geht mir ja nicht mehr nur um den Takt, ich wollte halt die ganzen Lanes einpacken, da es Intel ja nicht schafft.
Außerdem spiele ich halt meistens in WQHD und UHD
Und ein AMD CPU wäre auch mal was schönes

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yummycandy schrieb:

In der Tat haben nur 2 Dies direkten Memoryzugriff. Ohne die 2 zusätzlichen Dies würde die Kernanzahl bei Zen+ nicht hinkommen.

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Jau, so sagt er es ja auch im Video. Die ganzen Codenamen/Zwischenschritte überall, da kommt man schon mal durcheinander.

Ich dachte irgendwie TR2 wäre schon Zen2, wo es ja heißt dass die Kerne pro CCX verdoppelt werden - dann hätte auch ein 32Kern TR2 nur 2 aktivierte und 2 Dummy-Dies = jeder Die wäre mit 2 Kanälen an den RAM angebunden. Bei Zen+ ist dies ja noch nicht der Fall. Daher bin ich wieder da wo ich vorher war, TR2 wird - mit nur 4 Speicherkanälen (und damit 2 nicht mit dem RAM verbundenen Dies) - zumindest für mich ziemlich uninteressant.

AMD Zen 2 CPU Rumors: 16 Cores Ryzen, 32 Core Threadripper, 64 Core EPYC

Also ist der Threadripper mit 32 Kernen, auf den ich eigentlich warte, der Zen2 Threadripper 3. ^^



PS:
Eigentlich ist der ganze Sockel-Wahnsinn totaler Unsinn. Es gibt (bis jetzt) von AMD und Intel (welche derzeit noch aktuell sind) jeweils einen Mainstream-Sockel, einen Enthusiast-Sockel, und einen Server-Sockel. Bei Intel sind dass der Mainstream-Sockel 1151, der Enthusiast-Sockel 2066 und für die Server der Sockel 3647. Wobei Intel für CPUs >18 Kerne wohl irgendwie einen zweiten Enthusiast-Sockel einführen muß. Bei AMD sind es der Mainstream-AM4, Enthusiast TR4, und Server SP3.

Logisch weil einfach wäre es gewesen, direkt die Enthusiast-Plattform mit den Server-Sockeln zu bestücken - so wie zumindest Intel es demnächst ja eh muß. Das Argument "eigene Konkurrenz" bzgl. günstiger Server-Hardware laß ich dabei aus gutem Grund nicht zu; Alles an Server-Hardware für den PCIe-Steckplatz paßt auch in ein Mainstream-System. Von exotischen Ausnahmen abgesehen sollte quasi alles an Steckkarten (und damit auch Laufwerken usw) auch in ein Sockel 1151-/AM4-System passen. Selbst die teuersten HPC-Steckkarten passen in einen PCIe-Slot rein. Und den RAM kann man auch über die RAM-Sockel/das BIOS limitieren (damit man nicht für kleines Geld richtig viel RAM in den "Nicht-Server" packen kann)

Dann wäre so vieles so viel einfacher. Und AMD hätte schon mit dem ersten Threadripper in der größten Version (1990X) 32 Kerne und Octa-Channel anbieten können - die Lanes hätte man ja problemlos bei 64 lassen können (reicht für alles, und man hätte noch die Abgrenzung zu den 128 Lanes der Server). Die 10 Sockel TR4 Mobos wären auch im SP3-Layout nicht wirklich teurer gewesen.

Und mit den so möglichen 32 Kernen schon im TR1 hätte man Intels 18-Kerner (zumal beide zum gleichen Preis hätten verkauft werden können!!!) mal so richtig überrollt.

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Artikel schrieb:

Die Angabe zum Cache ist zwar näher am vermutlich realen Wert - 16 Mibibyte bietet selbst ein Ryzen 7 mit acht Kernen - aber vermutlich dennoch zu hoch

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Die 80 MB sind einfach L3 und L2 für alle CCX und Kerne zusammengerechnet (8*8 MiB L3 + 32*0.5 MiB L2). Kann man natürlich so nicht machen, aber da kommt zumindest die Zahl her.