Ryzen Threadripper: AMD bestätigt TDPs und L3-Caches

PCGH-Redaktion · 2. August 2017

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AMD hat seine CPU-Preisliste mit den ersten beiden TR4-CPUs Ryzen Threadripper 1950X und 1920X aktualisiert. Darin bestätigt der Chiphersteller die 180 Watt hohen TDPs und den 32 MiByte großen L3-Cache in beiden Fällen. In einer Präsentationsfolie bestätigte AMD derweil versteckt, dass der Ryzen Threadripper 1900X 16 MiByte L3-Cache nutzen wird.

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Medicate · 2. August 2017

AW: Ryzen Threadripper: AMD bestätigt TDPs und L3-Caches

Also ist der 1900X doch nicht das Cache Wunder mit 32 MiByte. Schade

Evandure · 2. August 2017

AW: Ryzen Threadripper: AMD bestätigt TDPs und L3-Caches

Dafür immerhin nicht beschnitten, was die PCIe Lanes angeht.
Und natürlich Quadchannel. Aber gut, den gibt es bei Intel auch.

Gerry1984 · 2. August 2017

AW: Ryzen Threadripper: AMD bestätigt TDPs und L3-Caches

Dass der 1900X nur 16 MiByte L3-Cache bekommt spricht dafür dass da wohl nur ein Zeppelin-Die aktiv ist bzw. pro Die nur ein CCX denn ansonsten hätte man ja wie beim R5 1500X den vollen Cache anbinden können. Immherin spart man sich so zusätzliche IF-Kommunikation.

[...]Bessere Zeppelin-Dies, die mit einer niedrigeren Spannung auskommen, könnten den Leistungsbedarf theoretisch etwas nach unten drücken.[...]

Passt dazu dass man hier auch auf maximal 4,2 GHz mit XFR takten lässt. Fragt sich nur, hat man hier selektiert oder mittlerweile die Fertigung besser im Griff um durchweg niedriegere Spannungen und leicht höheren Takt zu erlauben?

hanfi104 · 2. August 2017

AW: Ryzen Threadripper: AMD bestätigt TDPs und L3-Caches

Also doch 4+0 4+0, klingt für mich nach der besseren Entscheidung, denn die IF ist doch recht lahm, verglichen mit einem CCX selbst.

user42 · 2. August 2017

AW: Ryzen Threadripper: AMD bestätigt TDPs und L3-Caches

Hm, dann wäre für den 1900X doch nur (4+0)+(4+0) Konfiguration denkbar, sonst müssten die Kerne einzelner Module ohne L3 Cache auskommen oder kleineren als die Standard 8MB pro CCX, was ich nicht glaube.

Bunny_Joe · 2. August 2017

AW: Ryzen Threadripper: AMD bestätigt TDPs und L3-Caches

hanfi104 schrieb:
Also doch 4+0 4+0, klingt für mich nach der besseren Entscheidung, denn die IF ist doch recht lahm, verglichen mit einem CCX selbst.

user42 schrieb:
Hm, dann wäre für den 1900X doch nur (4+0)+(4+0) Konfiguration denkbar, sonst müssten die Kerne einzelner Module ohne L3 Cache auskommen oder kleineren als die Standard 8MB pro CCX, was ich nicht glaube.

Why Ryzen Threadripper has two extra chips

Da 2 der 4 Dies im Threadripper nur unbelichtete Siliziumstücke sind, wäre es wohl schwer für AMD eine (2+0)+(2+0)+(2+0)+(2+0) Konfiguration anzubieten :schief:

bastian123f · 2. August 2017

AW: Ryzen Threadripper: AMD bestätigt TDPs und L3-Caches

Evandure schrieb:
Dafür immerhin nicht beschnitten, was die PCIe Lanes angeht.
Und natürlich Quadchannel. Aber gut, den gibt es bei Intel auch.

Aber ein bischen teurer bei Intel.

Gerry1984 · 2. August 2017

AW: Ryzen Threadripper: AMD bestätigt TDPs und L3-Caches

Bunny_Joe schrieb:
Why Ryzen Threadripper has two extra chips

Da 2 der 4 Dies im Threadripper nur unbelichtete Siliziumstücke sind, wäre es wohl schwer für AMD eine (2+0)+(2+0)+(2+0)+(2+0) Konfiguration anzubieten

Ja aber bei zwei aktiven Dies man könnte auch 2+2+2+2 machen, also zwei Cores pro CCX, dann wäre theoretisch volle Cacheanbindung möglich. Hier hat doch keiner eine Konfiguartion aus vier Dies in den Raum gestellt.

bastian123f · 2. August 2017

AW: Ryzen Threadripper: AMD bestätigt TDPs und L3-Caches

Gerry1984 schrieb:
Ja aber bei zwei aktiven Dies man könnte auch 2+2+2+2 machen, also zwei Cores pro CCX, dann wäre theoretisch volle Cacheanbindung möglich. Hier hat doch keiner eine Konfiguartion aus vier Dies in den Raum gestellt.

Die vier Dies wurden ja schon gestern oder vorgestern abgeschrieben. Es werden 2 Dies diagonal benutzt

Honkalonka78 · 2. August 2017

AW: Ryzen Threadripper: AMD bestätigt TDPs und L3-Caches

Wäre ein interessanter Vergleich, ob ein 4+0+4+0 mit 16 MB Cache schneller ist als ein e 2+2+2+2 mit 32 MB Cache.

Denke es kommt auf die Anwendung an, in Spielen wird der 4+0 wohl besser dastehen, da weniger IF-Kommunikation nötig ist.
Man hat ihm aber im Vergleich zum 1800X 200 MHz mehr Basetakt gegeben (um evtl. IF auszugleichen), von daher hätte 2+2 auch gepasst.

Schaffe89 · 2. August 2017

AW: Ryzen Threadripper: AMD bestätigt TDPs und L3-Caches

Gerry1984 schrieb:
Dass der 1900X nur 16 MiByte L3-Cache bekommt spricht dafür dass da wohl nur ein Zeppelin-Die aktiv ist bzw. pro Die nur ein CCX denn ansonsten hätte man ja wie beim R5 1500X den vollen Cache anbinden können. Immherin spart man sich so zusätzliche IF-Kommunikation.

Ich denke das spricht eher dafür dass man wie bei dem Ryzen 5 1400 pro CCX den L3 von 8mb auf 4mb reduziert.
Also weiterhin 2+2+2+2 nur mit jeweils reduzierten L3 Caches pro CCX. Performanceseitig wird das wahrscheinlich einiges kosten.

hanfi104 · 2. August 2017

AW: Ryzen Threadripper: AMD bestätigt TDPs und L3-Caches

Bunny_Joe schrieb:
Why Ryzen Threadripper has two extra chips

Da 2 der 4 Dies im Threadripper nur unbelichtete Siliziumstücke sind, wäre es wohl schwer für AMD eine (2+0)+(2+0)+(2+0)+(2+0) Konfiguration anzubieten

bastian123f schrieb:
Die vier Dies wurden ja schon gestern oder vorgestern abgeschrieben. Es werden 2 Dies diagonal benutzt

Hab ich was verpasst? Ich verstehe nicht wie man aus unsern Aussagen auf eine 4 Die Kombi kommt? Ein DIE hat 2 CCX (2x 4 Kerne), daher die 4+0 4+0, wie kommt man da auf 4 DIEs? Das ist doch schon seit März die übliche Beschreibung der Ryzen CPUs, die 8 Kerner sind 4+4, die 6 Kerner sind 3+3 usw. Selbst im BIOS wird es so beschrieben.

Schaffe89 schrieb:
Ich denke das spricht eher dafür dass man wie bei dem Ryzen 5 1400 pro CCX den L3 von 8mb auf 4mb reduziert.

Für Spieler dürfte das schlecht sein, aber nachdem Threadripper doch eher der Enthusiast ist mit Gaming wohl eher als Nebensache könnte das natürlich auch interessant sein. Gerade Cinebench dürfte davon ja profitieren, denn die Threads sind ja unabhängig. Für Video Encoding sollte da auch seine Vorteile haben.

DKK007 · 2. August 2017

AW: Ryzen Threadripper: AMD bestätigt TDPs und L3-Caches

Treadripper hat zwei leere DIEs, die die zusätzlichen Chips von Epyc ersetzen. Allerdings hätte es da wohl auch ein billiges Stück Plaste getan.

bschicht86 · 2. August 2017

AW: Ryzen Threadripper: AMD bestätigt TDPs und L3-Caches

DKK007 schrieb:
Allerdings hätte es da wohl auch ein billiges Stück Plaste getan.

Wenn man wie Intel Zahnpasta eingesetzt hätte. Aber bei Verlöten ist ein Stück Plaste eher ... hinderlich :schief:

RichieMc85 · 2. August 2017

AW: Ryzen Threadripper: AMD bestätigt TDPs und L3-Caches

Schade der 1900x ist dadurch nicht wirklich mehr interessant. Die paar Prozent hätten gegen den 7820x ganz gut geholfen.

Khabarak · 2. August 2017

AW: Ryzen Threadripper: AMD bestätigt TDPs und L3-Caches

RichieMc85 schrieb:
Schade der 1900x ist dadurch nicht wirklich mehr interessant. Die paar Prozent hätten gegen den 7820x ganz gut geholfen.

Der 1900X ist auch eher interessant, wenn Du mehr als 28 PCIe Lanes haben willst.
Bei Threadripper sind es immer 64 Lanes.

bastian123f · 3. August 2017

AW: Ryzen Threadripper: AMD bestätigt TDPs und L3-Caches

Khabarak schrieb:
Der 1900X ist auch eher interessant, wenn Du mehr als 28 PCIe Lanes haben willst.
Bei Threadripper sind es immer 64 Lanes.

Bei AMD bekommt man zurzeit einfach mehr geboten für den gleichen Preis oder sogar billiger.
Der 1900x und i7-7820x liegen ja preislich auch fast gleichauf.

Ryzen Threadripper: AMD bestätigt TDPs und L3-Caches

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